三大瓶颈
超标量架构,其特点是解码器可以同时向一系列并行的功能单元发出多条指令。 推测执行,即 CPU 在分支决策之前推测执行它认为最有可能的分支结果。如果猜测正确,则向前迈出一步。如果猜测错误,则必须刷新通道并运行另一个分支。 无序执行,只要序列中的多条指令不相互依赖,它们就会无序运行。 实时内存访问跟踪,其中可能同时向内存发出多个内存请求。根据拥塞和流量情况,一些较晚发出的请求可能会较早返回。
一致性延迟
同步延迟
指令级并行
控制和数据平面
超越渐进式增长
使更高级别的缓存可配置为更大的缓存或更小的缓存加上一些内存,并能够动态重新配置以适应当前工作负载; 在每个缓存级别,使用预取器来隐藏更多的获取延迟; 即使使用有序 CPU,也允许无序内存请求,这样即使先前的请求仍处于挂起状态,也可以使用先返回的任何内容; 使用软件实现服务质量(QoS),以便为关键工作负载的某些核心提供优先权。
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