FPGA-Zynq基础课程内容

科技   2024-10-17 21:56   湖南  



Zynq基础基础课程内容概览:架构和底层逻辑;语法和时序基础;工具使用;资源分析;BlockDesign使用;Modelsim仿真;PL开发和例程;PS开发和例程;PS-PL控制交互;PS-PL DDR操作;Microblaze使用;其他待补充内容,满减价399,关注淘宝店铺领20优惠券,上车价379,需要的可以看看下面内容和文末淘宝链接。


Zynq和FPGA的区别

Zynq和FPGA的联系

FPGA底层逻辑简介 

FPGA和ASIC的区别和联系 

为什么用FPGA 

为什么用ZYNQ

Zynq架构介绍 

PS和PL,控制交互,数据交互 


时序逻辑和组合逻辑

建立时间和保持时间

Verilog基本语法

代码编码规范

语句和电路对应关系

跨时钟域处理方法


Vivado安装教程 

Modeslim安装教程

Vivado工具使用 

工具页面介绍  

如何添加文件 

建立一个工程

添加源文件

添加IP和例化

添加约束文件

添加仿真文件


如何分配引脚

为什么需要做引脚约束

如何确定引脚约束

如何使用gui做引脚约束

如何使用xdc写引脚约束

常见引脚约束的意思


如何查看rtl连接图 

如何查看rtl视图

rtl视图可以用来做啥

如何查看资源消耗

为啥查看资源消耗

如何查看资源消耗

查看总体资源消耗

查看模块资源消耗


BlockDesiger操作方法


如何自动连线

如何手动连线

如何连接GP

如何连接HP


如何分配自动地址

如何手动修改地址

如何理解各个地址


如何打包一个IP

如何添加IP

如何将模块加入BD

如何添加自定义IP


如何查看时钟频率

如何建立输入输出端口

如何拓展模块信号

如何修改模块名

如何建立层级

如何设置zynq


Zynq基础及常用IP仿真

仿真的必要性

大小工程仿真方法

仿真工具选取

Testbench和模块关系

基础仿真方法

Vivado仿真

Vivado-Modelsim联合仿真

Clock IP介绍及仿真

FIFO介绍及仿真

Bram介绍及仿真


Zynq PL开发

PL开发全流程

ILA调试方法

VIO调试方法

呼吸流水灯

UART频率灯

SPI回环

时钟分频点灯

IIC 读写逻辑

手写乘法器

手写除法器


Zynq MIG读写

MIG介绍和设置

MIG仿真

Axi MIG读写


Zynq Microblaze

Microblaze设置

Uart

Axi Gpio

Axi bram


Zynq PS开发

PS开发全流程

程序固化方法

Uart hello-world

Lwip介绍

Ps udp回环

Ps tcp回环

SD卡读写


Zynq PS-PL控制交互 

Zynq核参数设置

Sdk导入官方例子方法

AXI GPIO设置与控制方法

AXI BRAM设置与控制方法


Zynq PS DDR 读写控制 

ps数据通道设置方法

ps DDR参数设置

axi dma架构、设置和读写demo

axi vdma架构、设置和读写demo

axi datamover架构、设置和读写demo


......内容未完待续


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