Vivado与Modelsim联合仿真

科技   2024-08-26 08:00   湖南  




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做FPGA,仿真是必不可少的,xilinx平台下,可以用Vivado自带的工具进行仿真,也可以用Modelsim进行仿真,这两个有啥不同呢;首先从界面上来看,狼哥更喜欢Vivado自带的仿真界面,看起来更舒服一些,Modelsim看着有点古老;但是从效率上来说,Modelsim要更优一些,它所使用的资源会少一些,仿真速度会快一些,小工程没有太大区别,大工程就会看出速度上的差异了,所以今天来说说Vivado和Modelsim的联合仿真。
对于Vivado和Modelsim的安装,这里就不多说了,网上大把文章写这个,狼哥主要说下联合仿真需要做的事情,一是编译仿真库,另一个就是联合仿真设置。
先来说说编译仿真库,编译设置如下:
先从Tools下拉菜单中,选择“Compile Simulation Libraries”,打开编译设置界面。

点“Family”后年根据需要,选择需要编译的器件系列


仿真器选择Modelsim,根据实际情况设置编译库位置和Modelsim执行路径。取消编译Xilinx IP,加快编译库的速度。


编译开始“Tcl Console”显示如下:


编译结束“Tcl Console”显示如下,正常情况Error都为0。


库编译好之后,需要设置仿真的路径等,还是从Tools下拉菜单,选择Settings。


点击“Simulation”,选择目标仿真器为“Modelsim”,弹出对话框点“Yes”


设置编译库的路径


点击“3rd Party Simulators”,设置好Modelsim安装路径和编译库路径。


至此,所有设置就完成了,打开一个工程,写好测试激励,点击Run Behavioral Simulation下的“Run Behavioral Simulation”,即可启动Modelsim进行仿真了。

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