IC技术圈期刊 2024年第10期

IC技术圈期刊内容涵盖FPGA、算法、前端、验证、中端、后端、自动化、模拟、求职、管理等IC技术领域，欢迎阅读，欢迎投稿。

物理验证（PV）系统课专辑
#后端 #后端 #PnR #PV #STA
Physical Verification领域，系统性地介绍文章专辑！
RTL2GDS

布局布线（PnR）系统课专辑
#后端 #后端 #PnR #PV #STA
Place and Route领域，系统性地介绍文章专辑！
RTL2GDS

时序分析（STA）系统课专辑
#后端 #后端 #PnR #PV #STA
Statistical Timing Analysis领域，系统性地介绍文章专辑！
RTL2GDS

IC后端工程师学习路线路（自学宝典）
#后端 #后端 #PnR #PV #STA
一位IC后端工程师的自我修养手册！
RTL2GDS

代码是如何控制硬件的？
#FPGA #答疑
代码能够控制硬件，主要基于以下几个关键机制：首先，计算机系统中的硬件设备都有特定的寄存器，这些寄存器可以被软件访问和操作。通过代码向这些寄存器写入特定的值，就能够配置硬件的工作模式、参数等。其次，硬件与软件之间存在着明确的接口规范和通信协议。再者，硬件系统具有时钟信号，它为整个系统的运行提供了同步和节奏。代码的执行是在时钟的控制下逐步进行的，从而实现对硬件操作的精确控制。最后，操作系统也在其中发挥了重要作用。它提供了更高级的抽象和接口，使得应用程序能够更方便地与硬件进行交互，而无需直接处理底层的硬件细节。
FPGA技术江湖

ICC2：分段长tree简易教程
#后端 #CTS
分段长tree让局部sink balance的更好，有利于时序收敛，但传统的分段长tree需要单独写一个sdc去做sub tree再换回原始sdc去长tree，流程繁琐，我整理了一个简单的流程，不需要额外的sdc。
拾陆楼

学习Synopsys Fusion Compiler FE23: CCD优化与边界寄存器
#后端 #fusioncompiler
默认情况下，CCD会对所有寄存器（包括边界FF）进行时序偏斜优化。若要阻止在边界寄存器上进行延迟调整，请使用：ccd.optimize_boundary_timing -> set to false。不鼓励排除所有边界寄存器，因为这样做可能会严重影响CCD的优化潜力。仅在绝对必要时使用此设置。
32768Hz

异步电路碎碎念（八）多比特握手同步器
#前端 #同步
DMUX同步器完成之后继续完成多比特握手同步器，异步时钟域的握手同步器典型结构不只一种，还区分全握手和半握手，这里面的门道我也不是很专业，所以就只把熟悉的结构拿出来大家一起看下就好了。
芯时代青年

RISC-V笔记——基础
#前端 #RISCV
RISC-V旨在支持广泛的定制和专业化。RISC-V的ISA是由一个基本整型ISA和其它对基本ISA的可选扩展组成。每个整型ISA可以使用一个或多个可选的ISA扩展进行扩展。基本整型ISA精选了最小的一组指令，这些指令足以为编译器、汇编器、链接器和操作系统提供足够的功能，它提供了一组便利的ISA和软件工具链骨架，可以围绕它构建更多定制的处理器ISA。基本整型ISA与早期RISC处理器非常类似，除了没有分支延迟槽(branch delay slot)和可选的变长指令编码(Variable-length instruction encoding)。
专芯致志er

去马赛克的算法，你不了解一下吗？
#算法 #ISP #图像处理
日常生活中，我们经常接触到马赛克处理，它用于对图像特定区域进行模糊处理，使得模糊区域看上去由一个个小格子构成，从而隐去我们想遮挡的图像信息。ISP中存在一个模块，名为去马赛克（Demosaic, DMC），它是常规ISP中不可或缺的一个模块。大家常常误会：这个模块跟我们前面提到的“马赛克”是不是对应的？事实上并不是。ISP中的去马赛克模块完成的是将图像从RAW域变换到RGB域的任务。
OpenASIC

MicroBlaze最小系统搭建及程序固化
#FPGA #MicroBlaze
MicroBlaze是AMD-Xilinx提供的一个可以在FPGA中运行的嵌入式软核IP，其本质是一个32位RISC处理器软核，可以在150MHz时钟下，提供125 D-MIPS性能，具有运行速度快、占用资源少、可配置性强等优点。今天主要是搭建一个通用MicroBlaze最小系统+一个外设，最后固化程序到FPGA。
OpenFPGA

形式化验证简介及fm_shell脚本编写指南
#验证 #formality #lec
形式化验证是一种基于数学分析方法的验证技术，它通过算法引擎建立模型，对待测设计的状态空间进行穷尽分析的验证。在芯片设计中，形式化验证主要用于综合前后的等价性检查和RTL设计的功能验证。形式化验证的优势在于它可以提供精确、确定的结论，帮助开发人员减少迭代设计和测试的时间和成本 。
芯想事珹

国外应聘者面试时都会被问哪些问题
#求职就业 #FPGA
今天总结下/TechnicalBytes/针对国外应聘者“备考”及常用问题做的TIPS。首先大家可以看下以下几个问题：你能解释一下 FPGA 的基本架构吗？FPGA 在功能方面与微处理器有何不同？FPGA 在高频交易（HFT）中有哪些常见应用？能描述一下 Verilog 或 VHDL 等 HDL 在 FPGA 开发中的作用吗？对于一个项目来说，选择 FPGA 还是 ASIC 需要考虑哪些因素？如何处理 FPGA 设计中的电源和热管理？
OpenFPGA

聊聊倒装芯片（flip chip）的工艺流程
#后端 #工艺 #封装
倒装芯片的工艺流程是怎样的呢，本期我们来介绍下。倒装芯片分为两步：第一步是做凸点（bump）,凸点的类型有很多，如下图，最常见的有纯锡球，铜柱+锡球，金凸点等类型。第二步是将芯片安放到封装基板上。
Tom聊芯片智造

SoC入门-3自动驾驶AI芯片框架
#前端 #SOC #自动驾驶 #AI芯片
提到自动驾驶AI芯片，其实大家都在抄，那抄的来源是哪里？没错就是--漂亮国。上面图里面是特斯拉的一个自动驾驶AI芯片的架构图，下面的图是英伟达的。
那路谈OS与SoC嵌入式软件

SoC入门-4自动驾驶AI SoC芯片趋势
#前端 #SOC #自动驾驶 #AI芯片
之前的文章SoC入门-3自动驾驶AI芯片框架属于纯技术干货分享，本篇跳出来技术，看看未来AI SoC芯片一些可能的趋势，或许可更好的把握技术的学习和使用。
那路谈OS与SoC嵌入式软件

芯片设计公司正在工厂化
#管理
大部分国内芯片设计公司正在远离科技创新，进入工厂化模式。芯片设计公司正在工厂化的原因有三个，技术积累完成是其中之首。芯片设计研发人才过剩，加速芯片设计公司工厂化。降成本，是芯片设计公司工厂化的最大驱动力，而充足的上游资源将促进芯片设计公司工厂化。
钟林谈芯

2024年发布的CPU微架构汇总
#前端 #CPU
AMD Zen5、Ampere AmpereOne、ARM N3/V3、SIFIVE P870
亦安的数字小站

PCIe基础概念总结
#前端 #PCIe
PCIe的一条lane由两对差分线（TX和RX）组成，一个link由多条lane组成。PCIe的link宽度支持x1, x2, x4, x8, x12, x16, x32。PCIe RC（Root Complex）是PCIe树的根节点，一个RC可以包括多个RP（Root Port），例如一个16条lane的PCIe RC可以包括4个RP（4个x4的），或者8个RP（8个x2的）等等……
芯片架构笔记

为什么研发EUV光刻机那么难？
#后端 #光刻机
虽然表面上看，光刻机是半导体制造的工具之一，但它的背后涉及复杂的多学科交叉与全球化合作。1. 极端紫外光源的挑战：就像寻找“完美的灯泡” 2. 多层镀膜反射镜：好比打磨“完美的镜子” 3. 高精度对准与纳米级误差：像把大象装进针孔里 4. 全球供应链协作：像拼接世界上最复杂的拼图 5. 高昂的研发成本与长期积累：有点像马拉松而非短跑 6. 专利与知识产权：好比绕开一片“雷区” 7. 人员与人才储备：就好像建造一支顶尖的“特种部队”
老虎说芯

模拟芯片的快与慢
#模拟设计
本文解释模拟芯片的快、模拟芯片的慢
老虎说芯

NanDigits GOF人工智能辅助芯片功能ECO决策
#中端 #ECO #EDA #AI
ECO算法，尤其在功能ECO领域，涉及许多阶段，每个阶段都需要从一组潜在候选结果中选择最佳结果。这些阶段也包括关键点映射（keypoint mapping），算法必须比较参考网表和实现网表之间的数百个关键点对（keypoint pairs），以确定正确的mapping关系。同样，在端口反相检查时，算法必须确定数百个端口的相位是否有反相。这些操作是计算密集型的，不容易并行化，从而导致处理时间很长。这就是AI发挥作用的地方，ai提供了一个解决方案，从历史ECO数据中提取有意义的pattern。通过从过去的决策中学习，AI可以在新决策时提供智能的指导，从而大大提高效率。
NanDigits

CP测试与FT测试的区别
#自动化 #测试 #CP #FT
在集成电路（IC）制造与测试过程中，CP（Chip Probing，晶圆探针测试）和FT（Final Test，最终测试）是两个重要的环节，它们承担了不同的任务，使用不同的设备和方法，但都是为了保证产品的质量与可靠性。
老虎说芯

FPGA领域中”神“一样的人
#FPGA #开源项目
从20世纪80年代FPGA诞生以来，在这个领域诞生了无数个大神或者有突出贡献的领路者，今天我们就简单盘点一下那些近现代开源领域中的大神。
OpenFPGA

浅析VERDI和VCS联合仿真流程
#验证 #VCS #Verdi
VCS、Verdi介绍，Linux下VCS+Verdi仿真demo演示
芯想事珹

RTL设计：寻找一的个数
#前端 #Spinal
问题背景是这样的：一个64比特的数据掩码，其中为1的位置连续，求其中1的个数，即有效字节数。
Spinal FPGA

如何订阅“IC技术圈期刊”，及芯片领域常用RSS源介绍
#自媒体 #IC技术圈
本文介绍了订阅“IC技术圈期刊”的几种方法。“IC技术圈期刊”内容来自IC技术圈成员的优秀文章、IC技术圈专栏的优秀文章，以及IC设计行业的其它优秀技术文章等。
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IC技术圈介绍（2024版）
#自媒体 #IC技术圈
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